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• 负责SoC 系统集成工作，包括 CPU 子系统、片上外设及总线架构的设计与整合 • 负责 子系统 SDC 时序约束定义与收敛支持 • 负责子系统 UPF 相关文件编写及功耗策略实现 • 负责 RTL 代码检查（lint / CDC / RDC），提升设计质量 • 参与 SoC 安全启动流程设计与调试 • 与验证团队协作，支持 SoC 功能验证、系统级仿真及问题定位 • 配合后端团队完成设计交付，包括综合、时序收敛、功耗分析等问题的定位与修复 • 编写相关设计文档，保证设计可维护性
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负责芯片RISC-V内核编译的整体架构规划（RV64架构，包括标准扩展指令和自研指令集），包括支持和优化编译器前端解析，中端优化，后端代码生成等环节，提升编译效率，目标代码性能和代码密度。 和CPU设计团队，架构建模团队对内核优化方案做出评估，仿真和实现，并基于微架构特性进行编译器优化，包括指令的调度和优化，环境的搭建和测试，分析和测试指令性能瓶颈，并能找到合理的技术路线 对接软件应用需求，支持定义自定义指令扩展，编译器对自定义指令的支持，匹配和对应的逻辑，开发对应的编译插件，intrinsic函数以及优化，确保自定义指令高效集成到编译流程，发挥自定义芯片微架构的优势。…
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1）负责超大规模集群在训练、推理、数据传输等核心场景下的高性能网络系统的运维、设计和研发； 2）参与 RDMA、RoCEv2、DPDK 等高性能网络技术的落地与优化，构建极致低延迟、高带宽的通信能力； 3）深入开展大规模训练下的通信性能分析工作，运用先进分析与诊断工具，精准定位并优化性能瓶颈； 4）开发与优化基础网络服务系统，包括但不限于网络地址分配、负载均衡等，同时建设管控平台，实现大模型训练集群网络的自动化管理； 5）支持网络协议分析、性能调优、故障排查等系统级问题解决，提升系统整体稳定性与可观测性； 6）推进高性能网络与平台系统（如训练框架、Kubernetes、RPC 框架）之间的深…
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负责AI智算集群平台化及底层核心服务能力建设，负责智算集群架构设计与开发工作； 负责AI智算集群服务的建设，提升AI基础设施服务产品的稳定性与高效性； 负责智算集群领域前沿技术的探索，对训练、推理、仿真等场景的支持； 负责相关开源社区架构和代码贡献与维护。
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核心职责 1.时钟设计 主导SoC芯片级时钟架构规划，制定时钟树（ClockTree）方案包括 全局时钟分布、分频/门控策略、低功耗时钟切换等。 实现DFS,DVFS,AVFS等技术的方案制定和RTL设计，支持芯片功耗优 化,解决时钟切换时的glitch,处理器的di/dt等问题。 定义时钟约束（SDC），协同后端团队实现时钟树综合与优化。 2.复位设计 负责SoC芯片的复位架构设计，包括全局复位，局部复位，多电源域复 位策略 定义复位源（上电复位，看门狗复位，软件复位等）及其优先级管理 定义复位时序约束(SDC),确保复位路径满足时序要求。…
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1. 跟踪研究国家及地方重大发展战略、产业政策、宏观经济政策及行业监管动态，开展政策解读与趋势研判； 2. 独立承担政策课题研究、调研报告、决策咨询建议等成果的撰写与修订，支撑政府或企事业单位科学决策； 3. 参与政府项目、评估及实施效果分析，提出具有操作性的优化建议； 4. 协同政府部门、行业协会、高校及生态企业机构开展政策研讨、专题座谈及合作研究； 5. 定期整理汇编政策资料，维护更新政策解读资料体系。 6.公司负责人参加政府重要会议和会晤时提供备参和发言资料支撑
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1. 负责 CPU 核心模块的微架构设计与 RTL 实现，重点覆盖以下方向之一： ○ 取指与分支预测：Instruction Fetch、BTB/BHT/TAGE 等预测器设计、取指流水线 ○ 发射与调度：Issue Queue、Renaming、Scoreboard、Out-of-Order 调度逻辑 ○ 内存子系统：L1/L2 Cache 设计、TLB/MMU、Prefetcher、Memory Ordering ○ Cache 一致性：Snoop / Directory 协议实现、MESI/MOESI 状态机、 coherence 互连适配 2. 负责所设计模块的微架构 spec 编写…
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面向具身智能模型的预训练与监督微调，负责代表性模型在摩尔线程 GPU 平台上的适配、性能优化与稳定性建设。结合客户需求，深入主流开源训练框架，沉淀可复用的训练方案、数据管线和优化能力。 工作职责 1. 完成代表性视觉语言动作模型（VLA）的训练适配、正确性验证与性能基线建设。 2. 深入分析计算、显存、通信和数据加载瓶颈，优化训练吞吐、资源利用率及运行稳定性。 3. 优化混合精度、梯度累积、激活检查点和分布式训练策略，验证优化对数值精度与模型收敛的影响。 4. 优化多模态训练数据管线，包括数据读取、预处理、采样和加载。…
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岗位介绍 面向具身智能模型的后训练场景，负责策略推理、环境采样与模型训练之间的系统集成、性能优化和稳定性建设，推动相关任务在摩尔线程 GPU 平台上高效运行。 本岗位优先考察推理引擎、分布式训练及系统性能优化能力。具身智能或强化学习经验为加分项，团队提供相关算法与任务支持。 工作职责 1. 深入开源后训练框架，梳理进程、设备、数据和模型权重的执行与流转链路，完成任务适配和系统集成。 2. 建立端到端性能基线，分析策略推理、环境采样、模型训练、数据传输及权重同步等阶段的耗时与资源利用。 3. 优化批处理、资源分配、并行执行、同步机制及显存使用，减少组件等待，提高整体训练效率。…
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1. CPU 核模块 / 子系统功能验证 负责 CPU 流水线前端、后端核心模块验证：Fetch、BPU、Decode、Rename、Dispatch、Issue、Execute、LSU、ROB、Retire、ICache/DCache、TLB、异常中断、分支预测等核心微架构模块的 Pre-silicon 功能验证。 2. 验证环境搭建与用例开发 基于 SystemVerilog/UVM 搭建模块级、子系统级 Testbench；开发定向用例、约束随机指令用例、边界用例、异常用例，覆盖 CPU 完整指令集、流水线冲突、数据依赖、访存时序、流水线冲刷、stall、bubble 场景。…
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1. 参与 Graphics Trace / RayTracing Trace 相关工具链的开发与维护， VK Trim、DXR / VK RT trace 等方向的工程化落地。 2. 参与 MUSA API Trace / Compute Trace 方向的 capture / replay / verify 工程化建设
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1. 超节点产品架构定义与技术前瞻 负责AI训练/推理超节点整体架构与全栈产品方案设计，主导多GPU高速互联、Scale-up/Scale-out融合组网方案选型；定义GPU拓扑、内存、散热、基板模组等核心硬件规格。跟踪CXL、光电合封等前沿技术，结合大模型算力需求，完成中长期产品技术前瞻布局。 2. 生态合作与产品量产落地 协同ODM/OEM整机厂商，基于国产GPU特性联合定义超节点整机柜量产规格，推进生态合作落地。负责核心部件方案评审、可靠性测试、安规认证与可制造性优化，保障产品从0到1量产交付。统筹供应链、BOM及版本兼容性管理，优化产品配置体系，降低客户选型成本。…
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作为仿真系统的"性能转换层"，负责算子级别的性能评估、瓶颈分析与建模，是连接上层场景需求与底层硬件能力的核心枢纽。 核心职责 1. 算子性能深度分析 - 针对核心AI算子（GEMM、Conv、Attention、LayerNorm、Softmax等），分析其在特定硬件上的性能特征（Compute Bound / Memory Bound / Communication Bound）。 - 深入理解算子的实现细节（如Tiling策略、内存访问模式、指令调度、并行切分方式）及优化方法。 2. 算子性能模型构建 - 建立可扩展的算子性能模型，能够基于硬件参数（算力、带宽、延迟）预估算子在不同配置下…
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作为仿真系统的"产品实现者"，负责端到端仿真框架的设计与开发，将分散的场景定义、算子模型与硬件参数整合为统一的仿真产品，直接输出可指导业务决策的性能预测结果。 核心职责 1. 仿真框架架构设计与开发 - 设计并开发模块化、可扩展的仿真框架，整合场景定义模块、算子性能模型库、硬件参数配置等核心组件。 - 实现从单模型推理性能到完整Serving层性能（端到端延迟、系统吞吐、SLO达成率、资源利用率）的全链路仿真能力。 2. Serving层仿真能力构建 - 深入理解AI推理服务框架（如vLLM、TGI、SGLang等）的调度机制、批处理策略、缓存管理、负载均衡等核心逻辑。…
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作为仿真系统的"需求入口"，负责将前沿AI业务场景（LLM推理、文生视频、多模态服务等）转化为可量化、可仿真的技术指标体系，是连接业务需求与底层仿真的关键桥梁。 核心职责 1. 场景解构与指标定义 - 深入理解各类主流AI模型（LLM、Diffusion、多模态大模型等）的推理范式、服务调度机制及部署架构。 - 针对典型业务场景（如高并发LLM推理、长视频生成、实时交互等），定义关键性能指标（SLO）、算力需求、内存带宽需求、通信模式等核心参数。 - 建立场景分级体系，区分通用场景与极端场景，为仿真覆盖范围提供输入。…
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作为仿真系统的"硬件底座"，负责提供芯片及服务器架构的专业洞察，定义硬件能力的理论边界，是确保仿真结果与真实硬件高度一致的核心保障。 核心职责 1. 芯片微架构深度解析 - 深入理解主流AI芯片（GPU、NPU、DSA等）的微架构设计（计算单元、存储层次、互联拓扑、片内/片外带宽等）。 - 分析不同芯片架构对典型AI负载（如GEMM、Attention、Vector运算）的理论性能上限与瓶颈约束。 2. 系统级硬件评估 - 熟悉服务器级系统设计，包括多卡互联方案（NVLink、InfiniBand、RoCE等）、Switch互联拓扑、Mesh网络、超节点配置等。…
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1、负责GPU/AI芯片先进封装中 Silicon Interposer / 2.5D/3D IC 的物理设计与实现工作； 2、负责或参与 Floorplan规划、Netlist实现、Bump/Micro-bump规划、RDL Routing、PR/PV 等核心设计环节； 3、负责Interposer电源网络规划及 IR Drop / EM（IREM） 等分析与优化； 4、参与 DRC/LVS/ERC、ESD、Signoff 等物理验证工作，推动设计满足Foundry及先进封装工艺要求； 5、与Chip Backend、Package、SI/PI、DFT及Foundry团队协作，完成Inte…
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1.负责 SoC 中 DDR 子系统的设计、集成与调试，包括 DDR Controller、PHY 及相关子模块的系统级集成。 2.主导或参与 DDR bring‑up 全流程，覆盖仿真、FPGA/EMU 验证、硅后调试等阶段，定位并解决功能与性能问题。 3.参与 SoC 级性能分析与调优，围绕带宽、时延、QoS、功耗等指标，对 DDR 相关参数与架构进行优化。 4.协同前端 / 验证 / 后端团队，推动 DDR 子系统在 SoC 中的稳定落地，保障项目进度与质量。 5.参与 DDR 相关技术方案评估，支持不同业务场景（如GPU 等）对存储系统的需求。
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职位描述 1. 参与芯片高速接口子系统设计； 2. 参与超节点交换机设计； 3. 参与高速接口传输层、数据链路层、物理层的数字设计； 4. 撰写微架构文档，开发RTL代码，支持验证工作； 5. 协助子系统的物理实现，参与时序收敛与面积功耗优化； 6. 支持芯片回片调试工作。
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岗位职责： 1. 参与GPU平台相关软件开发，协助完成AI模型适配、GPU算子优化、软件与平台适配等工作，承担性能调优类任务； 2. 协助编写技术文档与培训材料，学习并支持GPU在数据中心、AI训练及推理等场景下的稳定运行； 3. 参与GPU产品在客户端的落地应用，协助排查应用场景中的问题及故障分析，实现GPU的广泛高效应用。
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角色和职责： 1）产品定义规划：负责芯片产品方向、规格、路线图和 MRD 等规划文档，明确产品要解决什么问题、面向哪些场景、做到什么规格。 2）需求洞察：调研客户需求、应用场景、部署环境、行业趋势、竞品动态和关键技术趋势，形成产品市场策略。 3）产品考量：与芯片架构、软硬件、AI、售前方案等团队协作，了解各方需求、技术限制，平衡成本、周期和可交付性。 4）节点把关：在项目评审、方案选择、规格 tradeoff 等阶段参与决策，确保开发方向符合市场与客户需求。 5）产品Go-To-Market：提炼产品差异化优势，输出产品规格书、方案材料、培训材料，赋能销售、售前等内部团队和外部合作伙伴。…
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岗位职责： 1. 参与测试平台的架构设计与功能开发，协助搭建面向LLM推理场景的测试用例体系、日志自动分析及性能异常预测系统； 2. 协助设计并搭建测试流水线，学习并支持根据业务需求完成测试执行、数据分析及测试报告撰写等工作； 3. 参与与GPU架构、驱动及算法团队的对接工作，协助优化大模型推理、AI算子的测试方案及性能基准目标，实现测试平台的高效稳定运行。
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职位描述 1. 参与高速接口IP的数字设计； 2. 参与IP数模接口定义和算法实现； 3. 撰写微架构文档，开发RTL代码，支持验证工作； 4. 协助IP在芯片上的物理实现，参与时序收敛与面积功耗优化； 5. 支持芯片回片调试工作。
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1. 负责芯片原型验证方案设计和实施，包括验证计划制定、测试方案设计、验证环境搭建等工作； 2. 独立完成芯片原型验证的测试工作，包括验证测试的编写、执行和结果分析； 3. 负责对硬件设备进行驱动开发，进行性能优化和故障排除； 4. 负责问题分析和解决，能够快速定位并解决验证过程中出现的问题； 5. 和相关团队密切合作，推动芯片原型验证的顺利进行； 6. 参与验证工具和流程的优化和改进，提高验证效率和质量。
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1. 确定TI ADC子系统的关键指标 (power, ENOB, area); 2. 根据SerDes系统的要求，确定TI ADC电路的架构； 3. 完成TI ADC开发，并协助RX顶层的整合工作； 4. 完成电路的设计和仿真验证； 5. 指导和协助版图设计，完成系统的后仿和调试 (post-layout simulations and tunings); 6. 完成TIADC的测试方案规划； 7. 撰写Serdes系统TIADC 的微架构/设计文档，支持验证工作； 8. 负责测试方案设计及芯片回片之后的相关调试。
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岗位职责 1. 负责高速低功耗嵌入式存储（SRAM、寄存器堆及新型存储）架构与电路全流程设计，按需开发存储器编译器； 2. 完成数字定制计算单元、标准单元等定制电路开发及物理落地。 3. 开展电路架构与拓扑优化，完成原理图、电路仿真、版图规划评审、全流程验证，输出时序/功耗/面积模型库特征化表征与配套 RTL 模型； 4. 结合芯片规格、工艺约束迭代器件与版图设计，权衡速度、功耗、面积及可靠性指标。 5. 协同相关团队搭建自动化设计流程，完成 DRC/LVS/ERC 物理验证，保障流片交付；复盘测试数据，迭代优化电路版图，沉淀设计规范。
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岗位职责描述 1. 确定TI ADC子系统的关键指标 (power, ENOB, area)； 2. 根据SerDes系统的要求，确定TI ADC电路的架构； 3. 完成TI ADC开发，并协助RX顶层的整合工作； 4. 完成电路的设计和仿真验证； 5. 指导和协助版图设计，完成系统的后仿和调试 (post-layout simulations and tunings)； 6. 完成TIADC的测试方案规划； 7. 撰写Serdes系统TIADC 的微架构/设计文档，支持验证工作； 8. 负责测试方案设计及芯片回片之后的相关调试。
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关于团队 芯片验证是GPU流片前的最后一道质量关卡。摩尔线程验证工程师覆盖模块级、子系统级到全芯片SoC的完整验证链路，同时承担系统级与性能验证工作。在这里，你会直接参与到国产全功能GPU的验证流程中，接触从图形渲染到AI算力集群的完整技术栈。 当前GPU设计正快速向Chiplet架构、超大算力集群演进，验证复杂度持续上升。我们采用UVM/Formal/Emulation/仿真加速等主流方法学，并持续探索AI辅助验证、CI/CD驱动的自动化回归等方向，以应对日益增长的验证挑战。 你的职责 ● 模块与子系统验证：负责GPU核心模块（如渲染管线、计算单元、内存子系统、互联网络等）的UVM验证环境…
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1. 低功耗方案设计 参与芯片低功耗设计方案的制定与实施，包括门控时钟（Clock Gating）、电源门控（Power Gating）、多电压域（Multi-Voltage）等低功耗技术 2. 功耗分析 负责功耗分析，使用PTPX、powerArtist等工具进行动态/静态功耗评估，完成全芯片功耗数据分析。 2. 功耗优化 负责推动模块功耗优化实现，包括微架构优化，RTL coding 优化，流程上功耗优化
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职位描述 1. 负责SerDes系统DSP架构和算法模块方案开发和设计，如Equalizer/CDR/Adaptation/Calibration等 2. 交付SerDes系统架构/算法模块设计文档和仿真链路： 3. 完成SerDes系统建模和算法仿真验证工作； 4. 配合系统建模实现DSP算法和系统模型、模拟电路的最优适配； 5. 负责芯片回片之后firmware调优。